Altera Agilex 27 发布：首个 Agilex 2X 平台，集成 800GbE、1.6TbE 与…
Altera Agilex 27 is the First Agilex 2X Platform Adding 800GbE and 1.6TbE and More - ServeTheHome
Altera 推出 Agilex 27，这是其 Agilex 2X 系列的首款产品，集成硬化 800GbE 和 1.6TbE 以太网、PCIe 6.0/7.0 支持，收发器速率最高 256Gbps，并引入 HyperFlow 全芯片分布式数据网络。Altera 称其第三代 HyperFlex 相比 Agilex 7 每瓦性能提升 1.8 倍。配套的 QuartusIQ AI 助手集成 MCP，内部基准显示设计创建最高快 10 倍、整体设计周期最高快 1.5 倍；QuartusIQ 本季度推出，Agilex 27 工程样片预计 2027 年下半年。
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Altera Agilex 27 目标市场
新一代 FPGA 的发布并不常见，因此这对我们来说有点令人兴奋。今天，Altera 推出 Agilex 27，作为其全新 Agilex 2X 产品组合中的首个系列。Agilex 27 将硬化的 800GbE 和 1.6TbE 以太网与 PCIe 6.0 和 7.0 支持相结合，并提供最高 256Gbps 的可配置收发器。更令人兴奋、也是我在预简报电话会议上了解到的是，Altera 还提供了一种新的 AI 辅助模式，用于让这些 FPGA 投入使用。
HyperFlow 与第三代 HyperFlex
Agilex 27 系列的一项重大新功能是 HyperFlow。HyperFlow 是一种新的全芯片分布式数据网络，Altera 称其可以在整个 FPGA 内以每秒数太比特的速率传输数据。该流量运行在专用网络上，而不是可编程逻辑架构上，因此不会消耗软逻辑资源，也不会增加布线拥塞。这为应用留出了更多 FPGA 资源。例如，一个 1.6TbE 以太网端口可以通过硬化 I/O 引入流量，HyperFlow 可以将其传输到整个芯片，而软逻辑可以将其资源用于处理而不是传输数据。
Altera Agilex 27 FPGA 架构
新系列具有用于 DDR5、LPDDR4、LPDDR5X 和 LPDDR6 的内存控制器。它还支持 UCIe，具有加密加速功能，以及 Arm Cortex-A720 和 Cortex-A520 核心。过去几年我们在 Altera 和 Xilinx 高端 FPGA 中看到的一个趋势是，可编程逻辑被更多硬化 IP 模块所包围，这有助于更快地完成设计。十年前，重点主要放在可编程逻辑元件和 I/O 上，但现在这里发生的事情要多得多。
Agilex 27 还带有分布在整个布线架构中的第三代 HyperFlex 寄存器。Altera 表示，Quartus Prime 可以通过这些寄存器对设计进行重定时和流水线化，而不会消耗逻辑资源。Altera 声称，Agilex 27 中的 HyperFlex 相比 Agilex 7 实现了 1.8 倍的代际每瓦性能提升。
Altera Agilex 2X FPGA 产品组合
Agilex 27 位于 Agilex 2X 产品组合的高性能端，高于中端 Agilex 25 以及价值优化的 Agilex 22 和 Agilex 23。Agilex 22 仅提供 FPGA，而 Agilex 23 增加了 SoC 选项。
QuartusIQ AI 助手
QuartusIQ 是 Quartus Prime 的 AI 助手，可帮助开发人员在编译、时序、调试和验证过程中确定步骤优先级。在 Altera 内部对使用和不使用 QuartusIQ 的 Quartus Prime 进行对比的基准测试中，设计创建速度最高提升 10 倍，整体设计周期最高提升 1.5 倍。该工具与 MCP 集成，并支持自带密钥（bring-your-own-key）设置。
Altera QuartusIQ FPGA 开发
在 NVIDIA GTC Berlin 2026 上，两家公司宣布这将引入新的 RTX Station 系统（我们一直在 STH 评测的 DGX Station 平台的 Windows 版本）。其理念是，你可以使用 QuartusIQ 和 MCP，以本地 NVIDIA Nemotron 作为模型，在芯片上设计和实现工作流。我很喜欢这一点。
结语
关于 FPGA 发布还需要了解的另一点是，发布与上市之间通常存在很大差距。我在电话会议上询问过，QuartusIQ 相关部分将在本季度推出，而 Agilex 27 工程样片预计在 2027 年下半年推出。我真正想知道的是，要等多久才能拿到 Agilex 27，并让本地模型通过 MCP 为我构建类似支持 RDMA 的 1.6TbE 网卡这样的东西。我的感觉是，这要到 2027 或 2028 年的时间框架才会发生。这也是我非常兴奋的事情，因为使用 FPGA 的一个障碍一直是你必须知道如何对它们进行编程。在某个时候，如果 Altera 和 Xilinx 能够提供进一步抽象硬件平台的 AI 工具，他们就可以扩大 FPGA 的使用范围。我的目标是能够拿到一块 FPGA 卡，并让 AI 代理在其上从零实现网卡或防火墙，而无需真正亲自动手设计 RTL。总有一天这会实现，我猜时间框架是 2027/2028 年。
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